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communication_serie_electronique

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Ci-dessous, les différences entre deux révisions de la page.

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communication_serie_electronique [2019/07/26 10:08] bigMaxcommunication_serie_electronique [2020/07/25 09:14] (Version actuelle) – [UART] bigMax
Ligne 9: Ligne 9:
   * débit faible ; dans le mode standard: 100 kbit/sec   * débit faible ; dans le mode standard: 100 kbit/sec
   * plusieurs master possibles sur le bus   * plusieurs master possibles sur le bus
-  * 2 fils pour la communication +  * 2 fils pour la communication "open drain" (collecteur ouvert) avec resistance de Pull-Up 
-  * La synchronisation est efféctué par un noeud master.+  * Nécéssite tout de même de partager une masse commune 
 +  * La synchronisation est efféctué par un noeud master 
 +  * Special START and STOP signals
   * SCL: Serial Clock Line — Signal d'horloge de synchronisation (généré par le master)   * SCL: Serial Clock Line — Signal d'horloge de synchronisation (généré par le master)
   * SDA: Serial Data Line — Sortie du Master / Entrées des Slaves   * SDA: Serial Data Line — Sortie du Master / Entrées des Slaves
 +
 +Modes
 +  * master transmit – master node is sending data to a slave
 +  * master receive – master node is receiving data from a slave
 +  * slave transmit – slave node is sending data to the master
 +  * slave receive – slave node is receiving data from the master
 +
  
 ==== SPI: Serial Peripheral Interface ==== ==== SPI: Serial Peripheral Interface ====
Ligne 42: Ligne 51:
 ==== UART ==== ==== UART ====
  
-{{tag>documentation theorie_fondamentale}}+{{tag>documentation theorie_fondamentale max}}
communication_serie_electronique.1564135734.txt.gz · Dernière modification : 2019/07/26 10:08 de bigMax